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  • Tese (Doutorado)

    Fast Code Exploration for Pipeline Processing in FPGA Accelerators (2019)

    Rosa, Leandro de Souza; Bonato, Vanderlei (Orientador)

    Unidade: ICMC

    Subjects: CIRCUITOS FPGA, HARDWARE, COMPUTAÇÃO RECONFIGURÁVEL

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    • ABNT

      ROSA, Leandro de Souza. Fast Code Exploration for Pipeline Processing in FPGA Accelerators. 2019. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2019. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21082019-143417/. Acesso em: 06 ago. 2024.

    • APA

      Rosa, L. de S. (2019). Fast Code Exploration for Pipeline Processing in FPGA Accelerators (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21082019-143417/

    • NLM

      Rosa L de S. Fast Code Exploration for Pipeline Processing in FPGA Accelerators [Internet]. 2019 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21082019-143417/

    • Vancouver

      Rosa L de S. Fast Code Exploration for Pipeline Processing in FPGA Accelerators [Internet]. 2019 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21082019-143417/

  • Dissertação (Mestrado)

    Um framework para agrupar funções com base no comportamento da comunicação de dados em plataformas multiprocessadas (2018)

    Santos, Rafael Ribeiro dos; Bonato, Vanderlei (Orientador)

    Unidade: ICMC

    Subjects: ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES, COMPUTAÇÃO RECONFIGURÁVEL, FRAMEWORKS

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    • ABNT

      SANTOS, Rafael Ribeiro dos. Um framework para agrupar funções com base no comportamento da comunicação de dados em plataformas multiprocessadas. 2018. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2018. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24102018-100329/. Acesso em: 06 ago. 2024.

    • APA

      Santos, R. R. dos. (2018). Um framework para agrupar funções com base no comportamento da comunicação de dados em plataformas multiprocessadas (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24102018-100329/

    • NLM

      Santos RR dos. Um framework para agrupar funções com base no comportamento da comunicação de dados em plataformas multiprocessadas [Internet]. 2018 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24102018-100329/

    • Vancouver

      Santos RR dos. Um framework para agrupar funções com base no comportamento da comunicação de dados em plataformas multiprocessadas [Internet]. 2018 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24102018-100329/

  • Tese (Doutorado)

    Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão (2017)

    Holanda, Jose Arnaldo Mascagni de; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, VISÃO COMPUTACIONAL, HARDWARE, SOFTWARES, CIRCULAÇÃO DE PEDESTRES

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    • ABNT

      HOLANDA, Jose Arnaldo Mascagni de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão. 2017. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/. Acesso em: 06 ago. 2024.

    • APA

      Holanda, J. A. M. de. (2017). Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/

    • NLM

      Holanda JAM de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/

    • Vancouver

      Holanda JAM de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/

  • Tese (Doutorado)

    Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras (2017)

    Martinez, Leandro Andrade; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: SISTEMAS EMBUTIDOS, VISÃO COMPUTACIONAL, COMPUTAÇÃO RECONFIGURÁVEL, PROJETO DE SOFTWARE, HARDWARE

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    • ABNT

      MARTINEZ, Leandro Andrade. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras. 2017. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/. Acesso em: 06 ago. 2024.

    • APA

      Martinez, L. A. (2017). Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/

    • NLM

      Martinez LA. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/

    • Vancouver

      Martinez LA. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/

  • Dissertação (Mestrado)

    A hardware/software codesign for the chemical reactivity of BRAMS (2017)

    Souza Junior, Carlos Alberto Oliveira de; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: HARDWARE, CIRCUITOS FPGA, PREVISÃO DO TEMPO, SOFTWARES, COMPUTAÇÃO RECONFIGURÁVEL

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    • ABNT

      SOUZA JUNIOR, Carlos Alberto Oliveira de. A hardware/software codesign for the chemical reactivity of BRAMS. 2017. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/. Acesso em: 06 ago. 2024.

    • APA

      Souza Junior, C. A. O. de. (2017). A hardware/software codesign for the chemical reactivity of BRAMS (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/

    • NLM

      Souza Junior CAO de. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/

    • Vancouver

      Souza Junior CAO de. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. 2017 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/

  • Tese (Doutorado)

    Sistema de hardware reconfigurável para navegação visual de veículos autônomos (2016)

    Dias, Maurício Acconcia; Osório, Fernando Santos (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, REDES NEURAIS, HARDWARE, VISÃO COMPUTACIONAL

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    • ABNT

      DIAS, Maurício Acconcia. Sistema de hardware reconfigurável para navegação visual de veículos autônomos. 2016. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2016. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012017-164142/. Acesso em: 06 ago. 2024.

    • APA

      Dias, M. A. (2016). Sistema de hardware reconfigurável para navegação visual de veículos autônomos (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012017-164142/

    • NLM

      Dias MA. Sistema de hardware reconfigurável para navegação visual de veículos autônomos [Internet]. 2016 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012017-164142/

    • Vancouver

      Dias MA. Sistema de hardware reconfigurável para navegação visual de veículos autônomos [Internet]. 2016 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012017-164142/

  • Dissertação (Mestrado)

    P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 (2016)

    Almeida Júnior, Carlos Roberto Pereira; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, SISTEMAS EMBUTIDOS

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    • ABNT

      ALMEIDA JÚNIOR, Carlos Roberto Pereira. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3. 2016. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2016. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/. Acesso em: 06 ago. 2024.

    • APA

      Almeida Júnior, C. R. P. (2016). P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/

    • NLM

      Almeida Júnior CRP. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 [Internet]. 2016 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/

    • Vancouver

      Almeida Júnior CRP. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 [Internet]. 2016 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/

  • Tese (Doutorado)

    ChipCflow: tool for convert C code in a static dataflow architecture in reconfigurable hardware (2015)

    Silva, Antonio Carlos Fernandes da; Silva, Jorge Luiz e (Orientador)

    Unidade: ICMC

    Subjects: VHDL, ARQUITETURA RECONFIGURÁVEL, COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS

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    • ABNT

      SILVA, Antonio Carlos Fernandes da. ChipCflow: tool for convert C code in a static dataflow architecture in reconfigurable hardware. 2015. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2015. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30062015-141638/. Acesso em: 06 ago. 2024.

    • APA

      Silva, A. C. F. da. (2015). ChipCflow: tool for convert C code in a static dataflow architecture in reconfigurable hardware (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30062015-141638/

    • NLM

      Silva ACF da. ChipCflow: tool for convert C code in a static dataflow architecture in reconfigurable hardware [Internet]. 2015 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30062015-141638/

    • Vancouver

      Silva ACF da. ChipCflow: tool for convert C code in a static dataflow architecture in reconfigurable hardware [Internet]. 2015 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30062015-141638/

  • Tese (Doutorado)

    LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs (2015)

    Oliveira, Cristiano Bacelar de; Cardoso, João Manuel Paiva (Orientador); Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, HARDWARE, GERADORES DE COMPILADORES

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    • ABNT

      OLIVEIRA, Cristiano Bacelar de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs. 2015. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2015. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/. Acesso em: 06 ago. 2024.

    • APA

      Oliveira, C. B. de. (2015). LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/

    • NLM

      Oliveira CB de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs [Internet]. 2015 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/

    • Vancouver

      Oliveira CB de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs [Internet]. 2015 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/

  • Dissertação (Mestrado)

    Otimização de memória cache em tempo de execução para o processador embarcado LEON3 (2014)

    Cuminato, Lucas Albers; Bonato, Vanderlei (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS, HARDWARE (ARQUITETURA), ROBÔS

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    • ABNT

      CUMINATO, Lucas Albers. Otimização de memória cache em tempo de execução para o processador embarcado LEON3. 2014. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2014. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-22092014-161846/. Acesso em: 06 ago. 2024.

    • APA

      Cuminato, L. A. (2014). Otimização de memória cache em tempo de execução para o processador embarcado LEON3 (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-22092014-161846/

    • NLM

      Cuminato LA. Otimização de memória cache em tempo de execução para o processador embarcado LEON3 [Internet]. 2014 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-22092014-161846/

    • Vancouver

      Cuminato LA. Otimização de memória cache em tempo de execução para o processador embarcado LEON3 [Internet]. 2014 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-22092014-161846/

  • Dissertação (Mestrado)

    Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera (2014)

    Pereira, Erinaldo da Silva; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS, HARDWARE

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    • ABNT

      PEREIRA, Erinaldo da Silva. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera. 2014. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2014. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/. Acesso em: 06 ago. 2024.

    • APA

      Pereira, E. da S. (2014). Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/

    • NLM

      Pereira E da S. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera [Internet]. 2014 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/

    • Vancouver

      Pereira E da S. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera [Internet]. 2014 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/

  • Tese (Doutorado)

    Co-projeto de hardware e software de um escalonador de processos para arquiteturas multicore heterogêneas baseadas em computação reconfigurável (2013)

    Bueno, Maikon Adiles Fernandez; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, HEURÍSTICA, HARDWARE (ENSINO)

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    • ABNT

      BUENO, Maikon Adiles Fernandez. Co-projeto de hardware e software de um escalonador de processos para arquiteturas multicore heterogêneas baseadas em computação reconfigurável. 2013. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-29012014-105417/. Acesso em: 06 ago. 2024.

    • APA

      Bueno, M. A. F. (2013). Co-projeto de hardware e software de um escalonador de processos para arquiteturas multicore heterogêneas baseadas em computação reconfigurável (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-29012014-105417/

    • NLM

      Bueno MAF. Co-projeto de hardware e software de um escalonador de processos para arquiteturas multicore heterogêneas baseadas em computação reconfigurável [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-29012014-105417/

    • Vancouver

      Bueno MAF. Co-projeto de hardware e software de um escalonador de processos para arquiteturas multicore heterogêneas baseadas em computação reconfigurável [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-29012014-105417/

  • Dissertação (Mestrado)

    Co-projeto hardware/software para cálculo de fluxo ótico (2013)

    Lobo, Tiago Mendonça; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: CIRCUITOS FPGA, COMPUTAÇÃO RECONFIGURÁVEL, PROGRAMAÇÃO CONCORRENTE, HARDWARE (ENSINO)

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      LOBO, Tiago Mendonça. Co-projeto hardware/software para cálculo de fluxo ótico. 2013. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28082013-094816/. Acesso em: 06 ago. 2024.

    • APA

      Lobo, T. M. Ã. §a. (2013). Co-projeto hardware/software para cálculo de fluxo ótico (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28082013-094816/

    • NLM

      Lobo TMça. Co-projeto hardware/software para cálculo de fluxo ótico [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28082013-094816/

    • Vancouver

      Lobo TMça. Co-projeto hardware/software para cálculo de fluxo ótico [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28082013-094816/

  • Dissertação (Mestrado)

    Um gerador de sistemas embarcados a partir de modelo independente de plataforma baseado no perfil MARTE (2013)

    Farias Filho, Roberto de Medeiros; Bonato, Vanderlei (Orientador)

    Unidade: ICMC

    Subjects: SISTEMAS EMBUTIDOS, VISÃO COMPUTACIONAL, COMPUTAÇÃO RECONFIGURÁVEL

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    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      FARIAS FILHO, Roberto de Medeiros. Um gerador de sistemas embarcados a partir de modelo independente de plataforma baseado no perfil MARTE. 2013. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24072013-161420/. Acesso em: 06 ago. 2024.

    • APA

      Farias Filho, R. de M. (2013). Um gerador de sistemas embarcados a partir de modelo independente de plataforma baseado no perfil MARTE (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24072013-161420/

    • NLM

      Farias Filho R de M. Um gerador de sistemas embarcados a partir de modelo independente de plataforma baseado no perfil MARTE [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24072013-161420/

    • Vancouver

      Farias Filho R de M. Um gerador de sistemas embarcados a partir de modelo independente de plataforma baseado no perfil MARTE [Internet]. 2013 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24072013-161420/

  • Dissertação (Mestrado)

    Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera (2012)

    Kiehn, Luiz Henrique; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS, HARDWARE (ENSINO), CIÊNCIA DA COMPUTAÇÃO (SISTEMAS COMPUTACIONAIS)

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      KIEHN, Luiz Henrique. Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera. 2012. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2012. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24012013-104256/. Acesso em: 06 ago. 2024.

    • APA

      Kiehn, L. H. (2012). Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24012013-104256/

    • NLM

      Kiehn LH. Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera [Internet]. 2012 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24012013-104256/

    • Vancouver

      Kiehn LH. Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera [Internet]. 2012 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-24012013-104256/

  • Tese (Doutorado)

    ChipCflow - uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável (2012)

    Lopes, Joelmir José; Silva, Jorge Luiz e (Orientador)

    Unidade: ICMC

    Subjects: PROGRAMAÇÃO PARALELA, COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      LOPES, Joelmir José. ChipCflow - uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável. 2012. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2012. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-05122012-154304/. Acesso em: 06 ago. 2024.

    • APA

      Lopes, J. J. (2012). ChipCflow - uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-05122012-154304/

    • NLM

      Lopes JJ. ChipCflow - uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável [Internet]. 2012 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-05122012-154304/

    • Vancouver

      Lopes JJ. ChipCflow - uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável [Internet]. 2012 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-05122012-154304/

  • Dissertação (Mestrado)

    Gerenciamento de tags na arquitetura ChipCflow - uma máquina a fluxo de dados dinâmica (2011)

    Silva, Bruno de Abreu; Silva, Jorge Luiz e (Orientador)

    Unidade: ICMC

    Subjects: ARQUITETURAS PARALELAS, COMPUTAÇÃO RECONFIGURÁVEL

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      SILVA, Bruno de Abreu. Gerenciamento de tags na arquitetura ChipCflow - uma máquina a fluxo de dados dinâmica. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-17052011-085128/. Acesso em: 06 ago. 2024.

    • APA

      Silva, B. de A. (2011). Gerenciamento de tags na arquitetura ChipCflow - uma máquina a fluxo de dados dinâmica (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-17052011-085128/

    • NLM

      Silva B de A. Gerenciamento de tags na arquitetura ChipCflow - uma máquina a fluxo de dados dinâmica [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-17052011-085128/

    • Vancouver

      Silva B de A. Gerenciamento de tags na arquitetura ChipCflow - uma máquina a fluxo de dados dinâmica [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-17052011-085128/

  • Dissertação (Mestrado)

    Projeto de um controlador PID para controle de ganho de uma câmera com sensor CMOS utilizando computação reconfigurável (2011)

    Rossi, Dráusio Linardi; Marques, Eduardo (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      ROSSI, Dráusio Linardi. Projeto de um controlador PID para controle de ganho de uma câmera com sensor CMOS utilizando computação reconfigurável. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012012-161407/. Acesso em: 06 ago. 2024.

    • APA

      Rossi, D. L. (2011). Projeto de um controlador PID para controle de ganho de uma câmera com sensor CMOS utilizando computação reconfigurável (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012012-161407/

    • NLM

      Rossi DL. Projeto de um controlador PID para controle de ganho de uma câmera com sensor CMOS utilizando computação reconfigurável [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012012-161407/

    • Vancouver

      Rossi DL. Projeto de um controlador PID para controle de ganho de uma câmera com sensor CMOS utilizando computação reconfigurável [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-13012012-161407/

  • Dissertação (Mestrado)

    Elaboração textual via definição de entidades mencionadas e de perguntas relacionadas aos verbos em textos simplificados do português (2011)

    Amancio, Marcelo Adriano; Aluísio, Sandra Maria (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, PROCESSAMENTO DE IMAGENS, PROCESSAMENTO DE LINGUAGEM NATURAL, INTELIGÊNCIA ARTIFICIAL

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      AMANCIO, Marcelo Adriano. Elaboração textual via definição de entidades mencionadas e de perguntas relacionadas aos verbos em textos simplificados do português. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-122100/. Acesso em: 06 ago. 2024.

    • APA

      Amancio, M. A. (2011). Elaboração textual via definição de entidades mencionadas e de perguntas relacionadas aos verbos em textos simplificados do português (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-122100/

    • NLM

      Amancio MA. Elaboração textual via definição de entidades mencionadas e de perguntas relacionadas aos verbos em textos simplificados do português [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-122100/

    • Vancouver

      Amancio MA. Elaboração textual via definição de entidades mencionadas e de perguntas relacionadas aos verbos em textos simplificados do português [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-122100/

  • Dissertação (Mestrado)

    Co-Projeto de hardware/software para correlação de imagens (2011)

    Dias, Maurício Acconcia; Osório, Fernando Santos (Orientador)

    Unidade: ICMC

    Subjects: COMPUTAÇÃO RECONFIGURÁVEL, ROBÓTICA, SISTEMAS EMBUTIDOS, PROCESSAMENTO DE IMAGENS

    Acesso à fonteHow to cite
    A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas

    • ABNT

      DIAS, Maurício Acconcia. Co-Projeto de hardware/software para correlação de imagens. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-124626/. Acesso em: 06 ago. 2024.

    • APA

      Dias, M. A. (2011). Co-Projeto de hardware/software para correlação de imagens (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-124626/

    • NLM

      Dias MA. Co-Projeto de hardware/software para correlação de imagens [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-124626/

    • Vancouver

      Dias MA. Co-Projeto de hardware/software para correlação de imagens [Internet]. 2011 ;[citado 2024 ago. 06 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082011-124626/

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