Efficient number of functional units and loop pipeline design Space exploration for high-level synthesis (2025)
- Authors:
- Autor USP: BONATO, VANDERLEI - ICMC
- Unidade: ICMC
- DOI: 10.5753/jbcs.2025.4912
- Subjects: ARQUITETURA DE SOFTWARE; HARDWARE; PARETO OTIMALIDADE
- Keywords: Design Space Exploration; High-Level Synthesis; Loop; Directives
- Agências de fomento:
- Language: Inglês
- Imprenta:
- Publisher place: Porto Alegre
- Date published: 2025
- Source:
- Título: Journal of the Brazilian Computer Society
- ISSN: 1678-4804
- Volume/Número/Paginação/Ano: v. 31, n. 1, p. 570-582, 2025
- Este periódico é de acesso aberto
- Este artigo NÃO é de acesso aberto
-
ABNT
ROSA, Leandro de Souza e BOUGANIS, Christos-Savvas e BONATO, Vanderlei. Efficient number of functional units and loop pipeline design Space exploration for high-level synthesis. Journal of the Brazilian Computer Society, v. 31, n. 1, p. 570-582, 2025Tradução . . Disponível em: https://doi.org/10.5753/jbcs.2025.4912. Acesso em: 14 fev. 2026. -
APA
Rosa, L. de S., Bouganis, C. -S., & Bonato, V. (2025). Efficient number of functional units and loop pipeline design Space exploration for high-level synthesis. Journal of the Brazilian Computer Society, 31( 1), 570-582. doi:10.5753/jbcs.2025.4912 -
NLM
Rosa L de S, Bouganis C-S, Bonato V. Efficient number of functional units and loop pipeline design Space exploration for high-level synthesis [Internet]. Journal of the Brazilian Computer Society. 2025 ; 31( 1): 570-582.[citado 2026 fev. 14 ] Available from: https://doi.org/10.5753/jbcs.2025.4912 -
Vancouver
Rosa L de S, Bouganis C-S, Bonato V. Efficient number of functional units and loop pipeline design Space exploration for high-level synthesis [Internet]. Journal of the Brazilian Computer Society. 2025 ; 31( 1): 570-582.[citado 2026 fev. 14 ] Available from: https://doi.org/10.5753/jbcs.2025.4912 - Designing FPGA-based embedded systems with MARTE: a PIM to PSM converter
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Informações sobre o DOI: 10.5753/jbcs.2025.4912 (Fonte: oaDOI API)
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