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Trabalho de evento
Toolbox nurbs and visualization system via FPGA (2011)
Silva, Luiz Marcelo Chiesse da; Paiva, Maria Stela Veludo de
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assuntos: CAD/CAM, INTERPOLAÇÃO
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ABNT
SILVA, Luiz Marcelo Chiesse da e PAIVA, Maria Stela Veludo de. Toolbox nurbs and visualization system via FPGA. 2011, Anais.. Córdoba: Escola de Engenharia de São Carlos, Universidade de São Paulo, 2011. . Acesso em: 23 nov. 2025.
APA
Silva, L. M. C. da, & Paiva, M. S. V. de. (2011). Toolbox nurbs and visualization system via FPGA. In Proceedings. Córdoba: Escola de Engenharia de São Carlos, Universidade de São Paulo.
NLM
Silva LMC da, Paiva MSV de. Toolbox nurbs and visualization system via FPGA. Proceedings. 2011 ;[citado 2025 nov. 23 ]
Vancouver
Silva LMC da, Paiva MSV de. Toolbox nurbs and visualization system via FPGA. Proceedings. 2011 ;[citado 2025 nov. 23 ]
Trabalho de evento
Proposal software design methodology for FPGA in space applications (2009)
Castellar, Anderson; Rodrigues, Evandro Luis Linhari
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assuntos: ARQUITETURA DE SOFTWARE, SATÉLITES
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ABNT
CASTELLAR, Anderson e RODRIGUES, Evandro Luis Linhari. Proposal software design methodology for FPGA in space applications. 2009, Anais.. Piscataway: IEEE, 2009. . Acesso em: 23 nov. 2025.
APA
Castellar, A., & Rodrigues, E. L. L. (2009). Proposal software design methodology for FPGA in space applications. In Proceedings. Piscataway: IEEE.
NLM
Castellar A, Rodrigues ELL. Proposal software design methodology for FPGA in space applications. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Vancouver
Castellar A, Rodrigues ELL. Proposal software design methodology for FPGA in space applications. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Trabalho de evento
Reconfigurable architecture for binary images invariant moments extraction (2009)
Jorge, Guilherme Henrique Reno; Roda, Valentin Obac; Oliver, Juan Pablo; Acle, Julio Perez; Fernández, Sebastian
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assunto: ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES
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ABNT
JORGE, Guilherme Henrique Reno et al. Reconfigurable architecture for binary images invariant moments extraction. 2009, Anais.. Piscataway: IEEE, 2009. . Acesso em: 23 nov. 2025.
APA
Jorge, G. H. R., Roda, V. O., Oliver, J. P., Acle, J. P., & Fernández, S. (2009). Reconfigurable architecture for binary images invariant moments extraction. In Proceedings. Piscataway: IEEE.
NLM
Jorge GHR, Roda VO, Oliver JP, Acle JP, Fernández S. Reconfigurable architecture for binary images invariant moments extraction. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Vancouver
Jorge GHR, Roda VO, Oliver JP, Acle JP, Fernández S. Reconfigurable architecture for binary images invariant moments extraction. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Trabalho de evento
Automatic VHDL generation for solving rotation and scale-invariant template matching in FPGA (2009)
Nobre, Henrique Pires de Almeida; Hae, Yong Kim
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EP
Assunto: PROCESSAMENTO DE IMAGENS
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ABNT
NOBRE, Henrique Pires de Almeida e HAE, Yong Kim. Automatic VHDL generation for solving rotation and scale-invariant template matching in FPGA. 2009, Anais.. New York: IEEE, 2009. . Acesso em: 23 nov. 2025.
APA
Nobre, H. P. de A., & Hae, Y. K. (2009). Automatic VHDL generation for solving rotation and scale-invariant template matching in FPGA. In Proceedings. New York: IEEE.
NLM
Nobre HP de A, Hae YK. Automatic VHDL generation for solving rotation and scale-invariant template matching in FPGA. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Vancouver
Nobre HP de A, Hae YK. Automatic VHDL generation for solving rotation and scale-invariant template matching in FPGA. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Trabalho de evento
Arquitetura em FPGA para o cálculo da transformada de distância genérica em tempo real (2009)
Luppe, Maximiliam
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assuntos: ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES, PROCESSAMENTO DE IMAGENS, ALGORITMOS
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ABNT
LUPPE, Maximiliam. Arquitetura em FPGA para o cálculo da transformada de distância genérica em tempo real. 2009, Anais.. Piscataway: IEEE, 2009. . Acesso em: 23 nov. 2025.
APA
Luppe, M. (2009). Arquitetura em FPGA para o cálculo da transformada de distância genérica em tempo real. In Proceedings. Piscataway: IEEE.
NLM
Luppe M. Arquitetura em FPGA para o cálculo da transformada de distância genérica em tempo real. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Vancouver
Luppe M. Arquitetura em FPGA para o cálculo da transformada de distância genérica em tempo real. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Trabalho de evento
Chopper-controlled PMDC motor drive using VHDL code (2009)
Castoldi, Marcelo Favoreto; Dias, Gabriel Rocha Carvalho; Aguiar, Manoel Luis de ; Roda, Valentin Obac
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assuntos: MOTORES DE INDUÇÃO (CONTROLE), MATLAB
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ABNT
CASTOLDI, Marcelo Favoreto et al. Chopper-controlled PMDC motor drive using VHDL code. 2009, Anais.. Piscataway: IEEE, 2009. . Acesso em: 23 nov. 2025.
APA
Castoldi, M. F., Dias, G. R. C., Aguiar, M. L. de, & Roda, V. O. (2009). Chopper-controlled PMDC motor drive using VHDL code. In Proceedings. Piscataway: IEEE.
NLM
Castoldi MF, Dias GRC, Aguiar ML de, Roda VO. Chopper-controlled PMDC motor drive using VHDL code. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Vancouver
Castoldi MF, Dias GRC, Aguiar ML de, Roda VO. Chopper-controlled PMDC motor drive using VHDL code. Proceedings. 2009 ;[citado 2025 nov. 23 ]
Trabalho de evento
FPGA based real time non-linear image processor (2008)
Pedrino, Emerson Carlos; Roda, Valentin Obac; Ogashawara, Osmar
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assuntos: TEMPO-REAL, ARQUITETURAS PARALELAS, PROCESSAMENTO DIGITAL DE IMAGENS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
PEDRINO, Emerson Carlos e RODA, Valentin Obac e OGASHAWARA, Osmar. FPGA based real time non-linear image processor. 2008, Anais.. Piscataway: IEEE, 2008. . Acesso em: 23 nov. 2025.
APA
Pedrino, E. C., Roda, V. O., & Ogashawara, O. (2008). FPGA based real time non-linear image processor. In Proceedings. Piscataway: IEEE.
NLM
Pedrino EC, Roda VO, Ogashawara O. FPGA based real time non-linear image processor. Proceedings. 2008 ;[citado 2025 nov. 23 ]
Vancouver
Pedrino EC, Roda VO, Ogashawara O. FPGA based real time non-linear image processor. Proceedings. 2008 ;[citado 2025 nov. 23 ]
Trabalho de evento
A control unit for a motion detector based on histograms (2008)
Roda, Valentin Obac; Minhoni, Danilo Carlos Rossetto
Fonte: Proceedings. Nome do evento: Southern Conference on Programmable Logic. Unidade: EESC
Assunto: VISÃO COMPUTACIONAL
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
RODA, Valentin Obac e MINHONI, Danilo Carlos Rossetto. A control unit for a motion detector based on histograms. 2008, Anais.. Piscataway: IEEE, 2008. . Acesso em: 23 nov. 2025.
APA
Roda, V. O., & Minhoni, D. C. R. (2008). A control unit for a motion detector based on histograms. In Proceedings. Piscataway: IEEE.
NLM
Roda VO, Minhoni DCR. A control unit for a motion detector based on histograms. Proceedings. 2008 ;[citado 2025 nov. 23 ]
Vancouver
Roda VO, Minhoni DCR. A control unit for a motion detector based on histograms. Proceedings. 2008 ;[citado 2025 nov. 23 ]

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