ReP USP - Resultado da busca

Tese (Doutorado)
Applying Rosenbrock method for solving stiff ODEs raised from the chemical reactivity of the atmosphere through heterogeneous architectures based on FPGAs (2023)
Souza Junior, Carlos Alberto Oliveira de ; Diniz, Pedro Nuno Cruz (coorient); Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: HARDWARE, CIRCUITOS FPGA, EQUAÇÕES DIFERENCIAIS ORDINÁRIAS
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ABNT
SOUZA JUNIOR, Carlos Alberto Oliveira de. Applying Rosenbrock method for solving stiff ODEs raised from the chemical reactivity of the atmosphere through heterogeneous architectures based on FPGAs. 2023. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2023. Disponível em: https://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082023-103217/. Acesso em: 27 maio 2024.
APA
Souza Junior, C. A. O. de. (2023). Applying Rosenbrock method for solving stiff ODEs raised from the chemical reactivity of the atmosphere through heterogeneous architectures based on FPGAs (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de https://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082023-103217/
NLM
Souza Junior CAO de. Applying Rosenbrock method for solving stiff ODEs raised from the chemical reactivity of the atmosphere through heterogeneous architectures based on FPGAs [Internet]. 2023 ;[citado 2024 maio 27 ] Available from: https://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082023-103217/
Vancouver
Souza Junior CAO de. Applying Rosenbrock method for solving stiff ODEs raised from the chemical reactivity of the atmosphere through heterogeneous architectures based on FPGAs [Internet]. 2023 ;[citado 2024 maio 27 ] Available from: https://www.teses.usp.br/teses/disponiveis/55/55134/tde-31082023-103217/
Artigo de periodico
Exploration of FPGA-based hardware designs for QR decomposition for solving stiff ODE numerical methods using the HARP hybrid architecture (2020)
Souza Junior, Carlos Alberto Oliveira de ; Bispo, João ; Cardoso, João Manuel Paiva ; Diniz, Pedro C; Marques, Eduardo
Source: Electronics. Unidade: ICMC
Subjects: EQUAÇÕES DIFERENCIAIS ORDINÁRIAS, HARDWARE
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ABNT
SOUZA JUNIOR, Carlos Alberto Oliveira de et al. Exploration of FPGA-based hardware designs for QR decomposition for solving stiff ODE numerical methods using the HARP hybrid architecture. Electronics, v. 9, n. 5, p. 1-14, 2020Tradução . . Disponível em: https://doi.org/10.3390/electronics9050843. Acesso em: 27 maio 2024.
APA
Souza Junior, C. A. O. de, Bispo, J., Cardoso, J. M. P., Diniz, P. C., & Marques, E. (2020). Exploration of FPGA-based hardware designs for QR decomposition for solving stiff ODE numerical methods using the HARP hybrid architecture. Electronics, 9( 5), 1-14. doi:10.3390/electronics9050843
NLM
Souza Junior CAO de, Bispo J, Cardoso JMP, Diniz PC, Marques E. Exploration of FPGA-based hardware designs for QR decomposition for solving stiff ODE numerical methods using the HARP hybrid architecture [Internet]. Electronics. 2020 ; 9( 5): 1-14.[citado 2024 maio 27 ] Available from: https://doi.org/10.3390/electronics9050843
Vancouver
Souza Junior CAO de, Bispo J, Cardoso JMP, Diniz PC, Marques E. Exploration of FPGA-based hardware designs for QR decomposition for solving stiff ODE numerical methods using the HARP hybrid architecture [Internet]. Electronics. 2020 ; 9( 5): 1-14.[citado 2024 maio 27 ] Available from: https://doi.org/10.3390/electronics9050843
Tese (Doutorado)
Um framework para coprojeto de hardware/software para o módulo da dinâmica do modelo brasileiro de previsão do tempo - BRAMS (2018)
Pereira, Erinaldo da Silva; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: FRAMEWORKS, CIRCUITOS FPGA, CIÊNCIA DA COMPUTAÇÃO, CLIMA
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ABNT
PEREIRA, Erinaldo da Silva. Um framework para coprojeto de hardware/software para o módulo da dinâmica do modelo brasileiro de previsão do tempo - BRAMS. 2018. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2018. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-27032019-145106/. Acesso em: 27 maio 2024.
APA
Pereira, E. da S. (2018). Um framework para coprojeto de hardware/software para o módulo da dinâmica do modelo brasileiro de previsão do tempo - BRAMS (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-27032019-145106/
NLM
Pereira E da S. Um framework para coprojeto de hardware/software para o módulo da dinâmica do modelo brasileiro de previsão do tempo - BRAMS [Internet]. 2018 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-27032019-145106/
Vancouver
Pereira E da S. Um framework para coprojeto de hardware/software para o módulo da dinâmica do modelo brasileiro de previsão do tempo - BRAMS [Internet]. 2018 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-27032019-145106/
Trabalho de evento
A flexible instruction set architecture filter for custom soft-core processors (2018)
Silva, Erinaldo Pereira; Souza Junior, Carlos Alberto Oliveira de; Melo, Thadeu Antonio Ferreira de; Marques, Eduardo
Source: Anais. Conference titles: Workshop em Computação Heterogênea - WCH. Unidade: ICMC
Subjects: HARDWARE, ANÁLISE DE DESEMPENHO, COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS
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ABNT
SILVA, Erinaldo Pereira et al. A flexible instruction set architecture filter for custom soft-core processors. 2018, Anais.. Porto Alegre: SBC, 2018. Disponível em: http://www2.sbc.org.br/wscad/current/anais/main-wscad-wch.pdf. Acesso em: 27 maio 2024.
APA
Silva, E. P., Souza Junior, C. A. O. de, Melo, T. A. F. de, & Marques, E. (2018). A flexible instruction set architecture filter for custom soft-core processors. In Anais. Porto Alegre: SBC. Recuperado de http://www2.sbc.org.br/wscad/current/anais/main-wscad-wch.pdf
NLM
Silva EP, Souza Junior CAO de, Melo TAF de, Marques E. A flexible instruction set architecture filter for custom soft-core processors [Internet]. Anais. 2018 ;[citado 2024 maio 27 ] Available from: http://www2.sbc.org.br/wscad/current/anais/main-wscad-wch.pdf
Vancouver
Silva EP, Souza Junior CAO de, Melo TAF de, Marques E. A flexible instruction set architecture filter for custom soft-core processors [Internet]. Anais. 2018 ;[citado 2024 maio 27 ] Available from: http://www2.sbc.org.br/wscad/current/anais/main-wscad-wch.pdf
Dissertação (Mestrado)
Coprojeto hardware/software das equações de Black-Scholes para precificação de opções no mercado financeiro (2018)
Costa, Thadeu Antonio Ferreira de Melo; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: MÉTODO DE MONTE CARLO, CIRCUITOS FPGA, GERAÇÃO DE NÚMEROS ALEATÓRIOS, MERCADO FINANCEIRO, BOLSA DE VALORES, FINANÇAS
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ABNT
COSTA, Thadeu Antonio Ferreira de Melo. Coprojeto hardware/software das equações de Black-Scholes para precificação de opções no mercado financeiro. 2018. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2018. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-19102018-102741/. Acesso em: 27 maio 2024.
APA
Costa, T. A. F. de M. (2018). Coprojeto hardware/software das equações de Black-Scholes para precificação de opções no mercado financeiro (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-19102018-102741/
NLM
Costa TAF de M. Coprojeto hardware/software das equações de Black-Scholes para precificação de opções no mercado financeiro [Internet]. 2018 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-19102018-102741/
Vancouver
Costa TAF de M. Coprojeto hardware/software das equações de Black-Scholes para precificação de opções no mercado financeiro [Internet]. 2018 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-19102018-102741/
Tese (Doutorado)
Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão (2017)
Holanda, Jose Arnaldo Mascagni de; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, VISÃO COMPUTACIONAL, HARDWARE, SOFTWARES, CIRCULAÇÃO DE PEDESTRES
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ABNT
HOLANDA, Jose Arnaldo Mascagni de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão. 2017. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/. Acesso em: 27 maio 2024.
APA
Holanda, J. A. M. de. (2017). Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/
NLM
Holanda JAM de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/
Vancouver
Holanda JAM de. Arquitetura multi-core reconfigurável para detecção de pedestres baseada em visão [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092017-085556/
Trabalho de evento-resumo
Exploiting Kant and Kimura’s matrix inversion algorithm on FPGA (2017)
Perina, André Bannwart; Matias, Paulo; Lima, João Miguel Gago Pontes de Brito; Marques, Eduardo; Bonato, Vanderlei
Source: Proceedings. Conference titles: Euromicro Conference on Digital System Design - DSD. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
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ABNT
PERINA, André Bannwart et al. Exploiting Kant and Kimura’s matrix inversion algorithm on FPGA. 2017, Anais.. Los Alamitos, CA: IEEE, 2017. Disponível em: https://doi.org/10.1109/DSD.2017.32. Acesso em: 27 maio 2024.
APA
Perina, A. B., Matias, P., Lima, J. M. G. P. de B., Marques, E., & Bonato, V. (2017). Exploiting Kant and Kimura’s matrix inversion algorithm on FPGA. In Proceedings. Los Alamitos, CA: IEEE. doi:10.1109/DSD.2017.32
NLM
Perina AB, Matias P, Lima JMGP de B, Marques E, Bonato V. Exploiting Kant and Kimura’s matrix inversion algorithm on FPGA [Internet]. Proceedings. 2017 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/DSD.2017.32
Vancouver
Perina AB, Matias P, Lima JMGP de B, Marques E, Bonato V. Exploiting Kant and Kimura’s matrix inversion algorithm on FPGA [Internet]. Proceedings. 2017 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/DSD.2017.32
Dissertação (Mestrado)
A hardware/software codesign for the chemical reactivity of BRAMS (2017)
Souza Junior, Carlos Alberto Oliveira de; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: HARDWARE, CIRCUITOS FPGA, PREVISÃO DO TEMPO, SOFTWARES, COMPUTAÇÃO RECONFIGURÁVEL
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SOUZA JUNIOR, Carlos Alberto Oliveira de. A hardware/software codesign for the chemical reactivity of BRAMS. 2017. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/. Acesso em: 27 maio 2024.
APA
Souza Junior, C. A. O. de. (2017). A hardware/software codesign for the chemical reactivity of BRAMS (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/
NLM
Souza Junior CAO de. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/
Vancouver
Souza Junior CAO de. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-21092017-170006/
Tese (Doutorado)
Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras (2017)
Martinez, Leandro Andrade; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, VISÃO COMPUTACIONAL, COMPUTAÇÃO RECONFIGURÁVEL, PROJETO DE SOFTWARE, HARDWARE
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MARTINEZ, Leandro Andrade. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras. 2017. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2017. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/. Acesso em: 27 maio 2024.
APA
Martinez, L. A. (2017). Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/
NLM
Martinez LA. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/
Vancouver
Martinez LA. Um framework para coprojeto de hardware e software de sistemas avançados de assistência ao motorista baseados em câmeras [Internet]. 2017 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-06122017-104613/
Trabalho de evento
A hardware/software codesign for the chemical reactivity of BRAMS (2017)
Souza Junior, Carlos Alberto Oliveira de; Pereira, Erinaldo da Silva; Marques, Eduardo
Source: Proceedings. Conference titles: Euromicro Conference on Digital System Design - DSD. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SOUZA JUNIOR, Carlos Alberto Oliveira de e PEREIRA, Erinaldo da Silva e MARQUES, Eduardo. A hardware/software codesign for the chemical reactivity of BRAMS. 2017, Anais.. Los Alamitos, CA: IEEE, 2017. Disponível em: https://doi.org/10.1109/DSD.2017.48. Acesso em: 27 maio 2024.
APA
Souza Junior, C. A. O. de, Pereira, E. da S., & Marques, E. (2017). A hardware/software codesign for the chemical reactivity of BRAMS. In Proceedings. Los Alamitos, CA: IEEE. doi:10.1109/DSD.2017.48
NLM
Souza Junior CAO de, Pereira E da S, Marques E. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. Proceedings. 2017 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/DSD.2017.48
Vancouver
Souza Junior CAO de, Pereira E da S, Marques E. A hardware/software codesign for the chemical reactivity of BRAMS [Internet]. Proceedings. 2017 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/DSD.2017.48
Trabalho de evento
A hardware/software codesign framework for vision-based ADAS (2016)
Martinez, Leandro A.; Holanda, José A. M.; Marques, Eduardo
Source: Actas. Conference titles: Jornadas sobre Sistemas Reconfiguráveis - REC'2016. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MARTINEZ, Leandro A. e HOLANDA, José A. M. e MARQUES, Eduardo. A hardware/software codesign framework for vision-based ADAS. 2016, Anais.. Aveiro, Portugal: Universidade de Aveiro – DETI / Instituto de Telecomunicações, 2016. Disponível em: https://doi.org/10.1109/FPL.2016.7577393. Acesso em: 27 maio 2024.
APA
Martinez, L. A., Holanda, J. A. M., & Marques, E. (2016). A hardware/software codesign framework for vision-based ADAS. In Actas. Aveiro, Portugal: Universidade de Aveiro – DETI / Instituto de Telecomunicações. doi:10.1109/FPL.2016.7577393
NLM
Martinez LA, Holanda JAM, Marques E. A hardware/software codesign framework for vision-based ADAS [Internet]. Actas. 2016 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/FPL.2016.7577393
Vancouver
Martinez LA, Holanda JAM, Marques E. A hardware/software codesign framework for vision-based ADAS [Internet]. Actas. 2016 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/FPL.2016.7577393
Trabalho de evento
Uma abordagem multi-softcore baseada em FPGA para o algoritmo HOG (2016)
Holanda, José Arnaldo Mascagni de; Cardoso, João Manuel Paiva; Marques, Eduardo
Source: Actas. Conference titles: Jornadas sobre Sistemas Reconfiguráveis - REC'2016. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
HOLANDA, José Arnaldo Mascagni de e CARDOSO, João Manuel Paiva e MARQUES, Eduardo. Uma abordagem multi-softcore baseada em FPGA para o algoritmo HOG. 2016, Anais.. Aveiro, Portugal: Universidade de Aveiro – DETI / Instituto de Telecomunicações, 2016. Disponível em: http://rec2016.utad.pt/docs/REC2016_Proceedings.pdf. Acesso em: 27 maio 2024.
APA
Holanda, J. A. M. de, Cardoso, J. M. P., & Marques, E. (2016). Uma abordagem multi-softcore baseada em FPGA para o algoritmo HOG. In Actas. Aveiro, Portugal: Universidade de Aveiro – DETI / Instituto de Telecomunicações. Recuperado de http://rec2016.utad.pt/docs/REC2016_Proceedings.pdf
NLM
Holanda JAM de, Cardoso JMP, Marques E. Uma abordagem multi-softcore baseada em FPGA para o algoritmo HOG [Internet]. Actas. 2016 ;[citado 2024 maio 27 ] Available from: http://rec2016.utad.pt/docs/REC2016_Proceedings.pdf
Vancouver
Holanda JAM de, Cardoso JMP, Marques E. Uma abordagem multi-softcore baseada em FPGA para o algoritmo HOG [Internet]. Actas. 2016 ;[citado 2024 maio 27 ] Available from: http://rec2016.utad.pt/docs/REC2016_Proceedings.pdf
Artigo de periodico
Clustering-based selection for the exploration of compiler optimization sequences (2016)
Martins, Luiz G. A; Nobre, Ricardo; Cardoso, João M. P; Delbem, Alexandre Cláudio Botazzo ; Marques, Eduardo
Source: ACM Transactions on Architecture and Code Optimization (TACO). Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA, ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MARTINS, Luiz G. A et al. Clustering-based selection for the exploration of compiler optimization sequences. ACM Transactions on Architecture and Code Optimization (TACO), v. 13, n. 1, p. 1-28, 2016Tradução . . Disponível em: https://doi.org/10.1145/2883614. Acesso em: 27 maio 2024.
APA
Martins, L. G. A., Nobre, R., Cardoso, J. M. P., Delbem, A. C. B., & Marques, E. (2016). Clustering-based selection for the exploration of compiler optimization sequences. ACM Transactions on Architecture and Code Optimization (TACO), 13( 1), 1-28. doi:10.1145/2883614
NLM
Martins LGA, Nobre R, Cardoso JMP, Delbem ACB, Marques E. Clustering-based selection for the exploration of compiler optimization sequences [Internet]. ACM Transactions on Architecture and Code Optimization (TACO). 2016 ; 13( 1): 1-28.[citado 2024 maio 27 ] Available from: https://doi.org/10.1145/2883614
Vancouver
Martins LGA, Nobre R, Cardoso JMP, Delbem ACB, Marques E. Clustering-based selection for the exploration of compiler optimization sequences [Internet]. ACM Transactions on Architecture and Code Optimization (TACO). 2016 ; 13( 1): 1-28.[citado 2024 maio 27 ] Available from: https://doi.org/10.1145/2883614
Trabalho de evento
Um framework para coprojeto de hardware e software de sistemas ADAS baseados em visão (2016)
Martinez, Leandro A.; Lobo, Tiago; Marques, Eduardo
Source: Anais. Conference titles: Congresso da Sociedade Brasileira de Computação - CSBC 2016. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MARTINEZ, Leandro A. e LOBO, Tiago e MARQUES, Eduardo. Um framework para coprojeto de hardware e software de sistemas ADAS baseados em visão. 2016, Anais.. Porto Alegre, RS: Sociedade Brasileira de Computação - SBC, 2016. Disponível em: http://ebooks.pucrs.br/edipucrs/anais/csbc/#/eventos. Acesso em: 27 maio 2024.
APA
Martinez, L. A., Lobo, T., & Marques, E. (2016). Um framework para coprojeto de hardware e software de sistemas ADAS baseados em visão. In Anais. Porto Alegre, RS: Sociedade Brasileira de Computação - SBC. Recuperado de http://ebooks.pucrs.br/edipucrs/anais/csbc/#/eventos
NLM
Martinez LA, Lobo T, Marques E. Um framework para coprojeto de hardware e software de sistemas ADAS baseados em visão [Internet]. Anais. 2016 ;[citado 2024 maio 27 ] Available from: http://ebooks.pucrs.br/edipucrs/anais/csbc/#/eventos
Vancouver
Martinez LA, Lobo T, Marques E. Um framework para coprojeto de hardware e software de sistemas ADAS baseados em visão [Internet]. Anais. 2016 ;[citado 2024 maio 27 ] Available from: http://ebooks.pucrs.br/edipucrs/anais/csbc/#/eventos
Dissertação (Mestrado)
P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 (2016)
Almeida Júnior, Carlos Roberto Pereira; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, SISTEMAS EMBUTIDOS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
ALMEIDA JÚNIOR, Carlos Roberto Pereira. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3. 2016. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2016. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/. Acesso em: 27 maio 2024.
APA
Almeida Júnior, C. R. P. (2016). P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/
NLM
Almeida Júnior CRP. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 [Internet]. 2016 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/
Vancouver
Almeida Júnior CRP. P2l - Uma ferramenta de profiling a nível de instrução para o processador softcore LEON3 [Internet]. 2016 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-18112016-091526/
Tese (Doutorado)
LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs (2015)
Oliveira, Cristiano Bacelar de; Cardoso, João Manuel Paiva (Orientador); Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: COMPUTAÇÃO RECONFIGURÁVEL, CIRCUITOS FPGA, HARDWARE, GERADORES DE COMPILADORES
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
OLIVEIRA, Cristiano Bacelar de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs. 2015. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2015. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/. Acesso em: 27 maio 2024.
APA
Oliveira, C. B. de. (2015). LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/
NLM
Oliveira CB de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs [Internet]. 2015 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/
Vancouver
Oliveira CB de. LALP+ : um framework para o desenvolvimento de aceleradores de hardware em FPGAs [Internet]. 2015 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-30082016-160232/
Artigo de periodico
Um processador de código aberto personalizável compatível com o ISA do NIOS II e o barramento Avalon (2015)
Pereira, Erinaldo; Matias, Paulo; Marques, Eduardo
Source: Perspectivas em Ciências Tecnológicas. Unidade: ICMC
Subjects: ARQUITETURA E ORGANIZAÇÃO DE COMPUTADORES, SISTEMAS EMBUTIDOS, ROBÓTICA, COMPUTAÇÃO EVOLUTIVA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
PEREIRA, Erinaldo e MATIAS, Paulo e MARQUES, Eduardo. Um processador de código aberto personalizável compatível com o ISA do NIOS II e o barramento Avalon. Perspectivas em Ciências Tecnológicas, v. 4, n. 4, p. 192-208, 2015Tradução . . Disponível em: http://www.fatece.edu.br/arquivos/arquivos%20revistas/perspectiva/volume4/12.pdf. Acesso em: 27 maio 2024.
APA
Pereira, E., Matias, P., & Marques, E. (2015). Um processador de código aberto personalizável compatível com o ISA do NIOS II e o barramento Avalon. Perspectivas em Ciências Tecnológicas, 4( 4), 192-208. Recuperado de http://www.fatece.edu.br/arquivos/arquivos%20revistas/perspectiva/volume4/12.pdf
NLM
Pereira E, Matias P, Marques E. Um processador de código aberto personalizável compatível com o ISA do NIOS II e o barramento Avalon [Internet]. Perspectivas em Ciências Tecnológicas. 2015 ; 4( 4): 192-208.[citado 2024 maio 27 ] Available from: http://www.fatece.edu.br/arquivos/arquivos%20revistas/perspectiva/volume4/12.pdf
Vancouver
Pereira E, Matias P, Marques E. Um processador de código aberto personalizável compatível com o ISA do NIOS II e o barramento Avalon [Internet]. Perspectivas em Ciências Tecnológicas. 2015 ; 4( 4): 192-208.[citado 2024 maio 27 ] Available from: http://www.fatece.edu.br/arquivos/arquivos%20revistas/perspectiva/volume4/12.pdf
Trabalho de evento
A special-purpose language for implementing pipelined FPGA-based accelerators (2015)
Oliveira, Cristiano B. de; Menotti, Ricardo; Cardoso, João Manuel Paiva; Marques, Eduardo
Source: Proceedings. Conference titles: Forum on Specification and Design Languages - FDL. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
OLIVEIRA, Cristiano B. de et al. A special-purpose language for implementing pipelined FPGA-based accelerators. 2015, Anais.. Los Alamitos, CA: IEEE, 2015. Disponível em: https://doi.org/10.1109/FDL.2015.7306085. Acesso em: 27 maio 2024.
APA
Oliveira, C. B. de, Menotti, R., Cardoso, J. M. P., & Marques, E. (2015). A special-purpose language for implementing pipelined FPGA-based accelerators. In Proceedings. Los Alamitos, CA: IEEE. doi:10.1109/FDL.2015.7306085
NLM
Oliveira CB de, Menotti R, Cardoso JMP, Marques E. A special-purpose language for implementing pipelined FPGA-based accelerators [Internet]. Proceedings. 2015 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/FDL.2015.7306085
Vancouver
Oliveira CB de, Menotti R, Cardoso JMP, Marques E. A special-purpose language for implementing pipelined FPGA-based accelerators [Internet]. Proceedings. 2015 ;[citado 2024 maio 27 ] Available from: https://doi.org/10.1109/FDL.2015.7306085
Tese (Doutorado)
Exploração de sequências de otimização do compilador baseada em técnicas hibridas de mineração de dados complexos (2015)
Martins, Luiz Gustavo Almeida; Delbem, Alexandre Cláudio Botazzo (Orientador) ; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, MINERAÇÃO DE DADOS, ALGORITMOS GENÉTICOS, MONTADORES E COMPILADORES
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MARTINS, Luiz Gustavo Almeida. Exploração de sequências de otimização do compilador baseada em técnicas hibridas de mineração de dados complexos. 2015. Tese (Doutorado) – Universidade de São Paulo, São Carlos, 2015. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28032016-160827/. Acesso em: 27 maio 2024.
APA
Martins, L. G. A. (2015). Exploração de sequências de otimização do compilador baseada em técnicas hibridas de mineração de dados complexos (Tese (Doutorado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28032016-160827/
NLM
Martins LGA. Exploração de sequências de otimização do compilador baseada em técnicas hibridas de mineração de dados complexos [Internet]. 2015 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28032016-160827/
Vancouver
Martins LGA. Exploração de sequências de otimização do compilador baseada em técnicas hibridas de mineração de dados complexos [Internet]. 2015 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-28032016-160827/
Dissertação (Mestrado)
Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera (2014)
Pereira, Erinaldo da Silva; Marques, Eduardo (Orientador)
Unidade: ICMC
Subjects: COMPUTAÇÃO RECONFIGURÁVEL, SISTEMAS EMBUTIDOS, HARDWARE
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
PEREIRA, Erinaldo da Silva. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera. 2014. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2014. Disponível em: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/. Acesso em: 27 maio 2024.
APA
Pereira, E. da S. (2014). Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/
NLM
Pereira E da S. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera [Internet]. 2014 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/
Vancouver
Pereira E da S. Projeto de um processador open source em Bluespec baseado no processador soft-core Nios II da Altera [Internet]. 2014 ;[citado 2024 maio 27 ] Available from: http://www.teses.usp.br/teses/disponiveis/55/55134/tde-25092014-094648/

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