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Trabalho de evento-resumo
Síntese de sistemas digitais em VHDL para tecnologias FPGA e ASIC (1998)
Ferreira, F A; Pereira, José Carlos
Conference titles: Simpósio de Iniciação Científica da Universidade de São Paulo. Unidade: EESC
Subjects: ENGENHARIA ELÉTRICA, PROCESSAMENTO DIGITAL DE SINAIS
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ABNT
FERREIRA, F A e PEREIRA, José Carlos. Síntese de sistemas digitais em VHDL para tecnologias FPGA e ASIC. 1998, Anais.. São Paulo: USP, 1998. . Acesso em: 23 maio 2024.
APA
Ferreira, F. A., & Pereira, J. C. (1998). Síntese de sistemas digitais em VHDL para tecnologias FPGA e ASIC. In . São Paulo: USP.
NLM
Ferreira FA, Pereira JC. Síntese de sistemas digitais em VHDL para tecnologias FPGA e ASIC. 1998 ;[citado 2024 maio 23 ]
Vancouver
Ferreira FA, Pereira JC. Síntese de sistemas digitais em VHDL para tecnologias FPGA e ASIC. 1998 ;[citado 2024 maio 23 ]
Trabalho de evento
Pathological discrimination of larynx through neural network (1998)
Rosa, Marcelo O; Pereira, José Carlos; Araújo, Simone Adad; Grellet, Marcos
Source: Proceedings. Conference titles: International Conference on Artificial Inteligence and Soft Computing. Unidades: EESC, FMRP
Subjects: PROCESSAMENTO DE SINAIS, INTELIGÊNCIA ARTIFICIAL, ENGENHARIA ELÉTRICA
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ABNT
ROSA, Marcelo O et al. Pathological discrimination of larynx through neural network. 1998, Anais.. Anaheim: IASTED/ACTA, 1998. . Acesso em: 23 maio 2024.
APA
Rosa, M. O., Pereira, J. C., Araújo, S. A., & Grellet, M. (1998). Pathological discrimination of larynx through neural network. In Proceedings. Anaheim: IASTED/ACTA.
NLM
Rosa MO, Pereira JC, Araújo SA, Grellet M. Pathological discrimination of larynx through neural network. Proceedings. 1998 ;[citado 2024 maio 23 ]
Vancouver
Rosa MO, Pereira JC, Araújo SA, Grellet M. Pathological discrimination of larynx through neural network. Proceedings. 1998 ;[citado 2024 maio 23 ]
Trabalho de evento
A new algorithm for QRS detection in ECG digital signal (1998)
Beraldo, O A; Pereira, José Carlos
Source: Proceedings. Conference titles: International Conference on Signal Processing Applications & Technology. Unidade: EESC
Subjects: PROCESSAMENTO DIGITAL DE SINAIS, BIOENGENHARIA, ENGENHARIA ELÉTRICA
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ABNT
BERALDO, O A e PEREIRA, José Carlos. A new algorithm for QRS detection in ECG digital signal. 1998, Anais.. San Francisco, CA: Miller Freeman, 1998. Disponível em: https://repositorio.usp.br/directbitstream/0bdadaab-62b9-4d40-93b1-f11575f748e8/prod_000788_sysno_999936.pdf. Acesso em: 23 maio 2024.
APA
Beraldo, O. A., & Pereira, J. C. (1998). A new algorithm for QRS detection in ECG digital signal. In Proceedings. San Francisco, CA: Miller Freeman. Recuperado de https://repositorio.usp.br/directbitstream/0bdadaab-62b9-4d40-93b1-f11575f748e8/prod_000788_sysno_999936.pdf
NLM
Beraldo OA, Pereira JC. A new algorithm for QRS detection in ECG digital signal [Internet]. Proceedings. 1998 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/0bdadaab-62b9-4d40-93b1-f11575f748e8/prod_000788_sysno_999936.pdf
Vancouver
Beraldo OA, Pereira JC. A new algorithm for QRS detection in ECG digital signal [Internet]. Proceedings. 1998 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/0bdadaab-62b9-4d40-93b1-f11575f748e8/prod_000788_sysno_999936.pdf
Trabalho de evento-resumo
Projeto de um sensor térmico inteligente (1997)
Caltabiano, S E; Pereira, José Carlos
Source: Simpósio de Iniciação Científica da Universidade de São Paulo, 5. Conference titles: Simpósio de Iniciação Científica da Universidade de São Paulo. Unidade: EESC
Subjects: CIRCUITOS ELETRÔNICOS, ENGENHARIA ELÉTRICA
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ABNT
CALTABIANO, S E e PEREIRA, José Carlos. Projeto de um sensor térmico inteligente. 1997, Anais.. São Paulo: USP, 1997. . Acesso em: 23 maio 2024.
APA
Caltabiano, S. E., & Pereira, J. C. (1997). Projeto de um sensor térmico inteligente. In Simpósio de Iniciação Científica da Universidade de São Paulo, 5. São Paulo: USP.
NLM
Caltabiano SE, Pereira JC. Projeto de um sensor térmico inteligente. Simpósio de Iniciação Científica da Universidade de São Paulo, 5. 1997 ;[citado 2024 maio 23 ]
Vancouver
Caltabiano SE, Pereira JC. Projeto de um sensor térmico inteligente. Simpósio de Iniciação Científica da Universidade de São Paulo, 5. 1997 ;[citado 2024 maio 23 ]
Trabalho de evento-resumo
Sistema deconvolutivo em VHDL (1997)
Ferreira, F A; Pereira, José Carlos
Conference titles: Simpósio de Iniciação Científica da Universidade de São Paulo. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
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ABNT
FERREIRA, F A e PEREIRA, José Carlos. Sistema deconvolutivo em VHDL. 1997, Anais.. São Paulo: USP, 1997. . Acesso em: 23 maio 2024.
APA
Ferreira, F. A., & Pereira, J. C. (1997). Sistema deconvolutivo em VHDL. In . São Paulo: USP.
NLM
Ferreira FA, Pereira JC. Sistema deconvolutivo em VHDL. 1997 ;[citado 2024 maio 23 ]
Vancouver
Ferreira FA, Pereira JC. Sistema deconvolutivo em VHDL. 1997 ;[citado 2024 maio 23 ]
Artigo de periodico
Analog sub-circuits on a cmos sea of gate (1994)
Saez, R T L; Pereira, J C
Source: Modelling, Measurement & Control, a. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
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ABNT
SAEZ, R T L e PEREIRA, J C. Analog sub-circuits on a cmos sea of gate. Modelling, Measurement & Control, a, v. 58, n. 4 , p. 7-17, 1994Tradução . . Acesso em: 23 maio 2024.
APA
Saez, R. T. L., & Pereira, J. C. (1994). Analog sub-circuits on a cmos sea of gate. Modelling, Measurement & Control, a, 58( 4 ), 7-17.
NLM
Saez RTL, Pereira JC. Analog sub-circuits on a cmos sea of gate. Modelling, Measurement & Control, a. 1994 ;58( 4 ): 7-17.[citado 2024 maio 23 ]
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Saez RTL, Pereira JC. Analog sub-circuits on a cmos sea of gate. Modelling, Measurement & Control, a. 1994 ;58( 4 ): 7-17.[citado 2024 maio 23 ]
Trabalho de evento
Finite state machine and an arithmetic logic unit customized for butterfly computations (1994)
Sanches, V P; Pereira, J C
Source: Proceedings. Conference titles: International Conference on Information Processing. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
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ABNT
SANCHES, V P e PEREIRA, J C. Finite state machine and an arithmetic logic unit customized for butterfly computations. 1994, Anais.. New Orleans: Amse, 1994. . Acesso em: 23 maio 2024.
APA
Sanches, V. P., & Pereira, J. C. (1994). Finite state machine and an arithmetic logic unit customized for butterfly computations. In Proceedings. New Orleans: Amse.
NLM
Sanches VP, Pereira JC. Finite state machine and an arithmetic logic unit customized for butterfly computations. Proceedings. 1994 ;[citado 2024 maio 23 ]
Vancouver
Sanches VP, Pereira JC. Finite state machine and an arithmetic logic unit customized for butterfly computations. Proceedings. 1994 ;[citado 2024 maio 23 ]
Trabalho de evento
Engenharia concorrente e microeletronica , as novas abordagens da engenharia e as transformacoes do ensino em engenharia eletrica (1993)
Saez, R T L; Pereira, J C; Nóbrega, Kleber Cavalcanti; Gesualdo, E
Conference titles: Congresso Brasileiro de Ensino de Engenharia. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SAEZ, R T L et al. Engenharia concorrente e microeletronica , as novas abordagens da engenharia e as transformacoes do ensino em engenharia eletrica. 1993, Anais.. Belo Horizonte: Abenge/Ee-Ufmg, 1993. . Acesso em: 23 maio 2024.
APA
Saez, R. T. L., Pereira, J. C., Nóbrega, K. C., & Gesualdo, E. (1993). Engenharia concorrente e microeletronica , as novas abordagens da engenharia e as transformacoes do ensino em engenharia eletrica. In . Belo Horizonte: Abenge/Ee-Ufmg.
NLM
Saez RTL, Pereira JC, Nóbrega KC, Gesualdo E. Engenharia concorrente e microeletronica , as novas abordagens da engenharia e as transformacoes do ensino em engenharia eletrica. 1993 ;[citado 2024 maio 23 ]
Vancouver
Saez RTL, Pereira JC, Nóbrega KC, Gesualdo E. Engenharia concorrente e microeletronica , as novas abordagens da engenharia e as transformacoes do ensino em engenharia eletrica. 1993 ;[citado 2024 maio 23 ]
Trabalho de evento
Vlsi hardware development to implement a fft (fast fourier transform algorithm) (1993)
Sanches, V P; Pereira, J C
Source: Anais. Conference titles: Congresso da Sociedade Brasileira de Microeletrônica. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SANCHES, V P e PEREIRA, J C. Vlsi hardware development to implement a fft (fast fourier transform algorithm). 1993, Anais.. Campinas: SBM, 1993. . Acesso em: 23 maio 2024.
APA
Sanches, V. P., & Pereira, J. C. (1993). Vlsi hardware development to implement a fft (fast fourier transform algorithm). In Anais. Campinas: SBM.
NLM
Sanches VP, Pereira JC. Vlsi hardware development to implement a fft (fast fourier transform algorithm). Anais. 1993 ;[citado 2024 maio 23 ]
Vancouver
Sanches VP, Pereira JC. Vlsi hardware development to implement a fft (fast fourier transform algorithm). Anais. 1993 ;[citado 2024 maio 23 ]
Trabalho de evento
Analog sub-circuits integrated on a cmos sea-of-gate environment (1993)
Saez, R T L; Pereira, J C
Source: Anais. Conference titles: Congresso da Sociedade Brasileira de Microeletronica. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SAEZ, R T L e PEREIRA, J C. Analog sub-circuits integrated on a cmos sea-of-gate environment. 1993, Anais.. Campinas: SBM, 1993. . Acesso em: 23 maio 2024.
APA
Saez, R. T. L., & Pereira, J. C. (1993). Analog sub-circuits integrated on a cmos sea-of-gate environment. In Anais. Campinas: SBM.
NLM
Saez RTL, Pereira JC. Analog sub-circuits integrated on a cmos sea-of-gate environment. Anais. 1993 ;[citado 2024 maio 23 ]
Vancouver
Saez RTL, Pereira JC. Analog sub-circuits integrated on a cmos sea-of-gate environment. Anais. 1993 ;[citado 2024 maio 23 ]
Trabalho de evento-resumo
Chip lmv-91: parte logica (1991)
Benez, L H; Pereira, J C
Source: Anais. Conference titles: Congresso de Iniciacao Cientifica e Tecnologica em Engenharia. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
BENEZ, L H e PEREIRA, J C. Chip lmv-91: parte logica. 1991, Anais.. Sao Carlos: Eesc-Usp, 1991. Disponível em: https://repositorio.usp.br/directbitstream/fb2c3138-f531-4f12-b364-882d23ff3718/PROD_001926_SYSNO_833558.pdf. Acesso em: 23 maio 2024.
APA
Benez, L. H., & Pereira, J. C. (1991). Chip lmv-91: parte logica. In Anais. Sao Carlos: Eesc-Usp. Recuperado de https://repositorio.usp.br/directbitstream/fb2c3138-f531-4f12-b364-882d23ff3718/PROD_001926_SYSNO_833558.pdf
NLM
Benez LH, Pereira JC. Chip lmv-91: parte logica [Internet]. Anais. 1991 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/fb2c3138-f531-4f12-b364-882d23ff3718/PROD_001926_SYSNO_833558.pdf
Vancouver
Benez LH, Pereira JC. Chip lmv-91: parte logica [Internet]. Anais. 1991 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/fb2c3138-f531-4f12-b364-882d23ff3718/PROD_001926_SYSNO_833558.pdf
Trabalho de evento-resumo
Chip lmv-91: implementacao (1991)
Souza, M A E; Pereira, J C
Source: Anais. Conference titles: Congresso de Iniciacao Cientifica e Tecnologica em Engenharia. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SOUZA, M A E e PEREIRA, J C. Chip lmv-91: implementacao. 1991, Anais.. Sao Carlos: Eesc-Usp, 1991. Disponível em: https://repositorio.usp.br/directbitstream/7e2598ef-87b7-4cdc-9b90-83970f07e657/PROD_001926_SYSNO_833557.pdf. Acesso em: 23 maio 2024.
APA
Souza, M. A. E., & Pereira, J. C. (1991). Chip lmv-91: implementacao. In Anais. Sao Carlos: Eesc-Usp. Recuperado de https://repositorio.usp.br/directbitstream/7e2598ef-87b7-4cdc-9b90-83970f07e657/PROD_001926_SYSNO_833557.pdf
NLM
Souza MAE, Pereira JC. Chip lmv-91: implementacao [Internet]. Anais. 1991 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/7e2598ef-87b7-4cdc-9b90-83970f07e657/PROD_001926_SYSNO_833557.pdf
Vancouver
Souza MAE, Pereira JC. Chip lmv-91: implementacao [Internet]. Anais. 1991 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/7e2598ef-87b7-4cdc-9b90-83970f07e657/PROD_001926_SYSNO_833557.pdf
Artigo de periodico
SIMLAR: um programa para a simulacao da laringe durante a fonacao (1990)
Pereira, J C
Source: Rbe. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
PEREIRA, J C. SIMLAR: um programa para a simulacao da laringe durante a fonacao. Rbe, v. 7, n. 1, p. 486-498, 1990Tradução . . Acesso em: 23 maio 2024.
APA
Pereira, J. C. (1990). SIMLAR: um programa para a simulacao da laringe durante a fonacao. Rbe, 7( 1), 486-498.
NLM
Pereira JC. SIMLAR: um programa para a simulacao da laringe durante a fonacao. Rbe. 1990 ; 7( 1): 486-498.[citado 2024 maio 23 ]
Vancouver
Pereira JC. SIMLAR: um programa para a simulacao da laringe durante a fonacao. Rbe. 1990 ; 7( 1): 486-498.[citado 2024 maio 23 ]
Trabalho de evento-resumo
Simulacao e lay-out de circuitos integrados (1990)
Leo Junior, I; Pereira, J C
Source: Anais Cicte-90. Conference titles: Congresso de Iniciacao Cientifica e Tecnologica em Engenharia. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
LEO JUNIOR, I e PEREIRA, J C. Simulacao e lay-out de circuitos integrados. 1990, Anais.. Sao Carlos: Cetepe, 1990. Disponível em: https://repositorio.usp.br/directbitstream/96a9eccd-6435-4c54-bb4f-088815d68be8/prod_001925_sysno_0827656.pdf. Acesso em: 23 maio 2024.
APA
Leo Junior, I., & Pereira, J. C. (1990). Simulacao e lay-out de circuitos integrados. In Anais Cicte-90. Sao Carlos: Cetepe. Recuperado de https://repositorio.usp.br/directbitstream/96a9eccd-6435-4c54-bb4f-088815d68be8/prod_001925_sysno_0827656.pdf
NLM
Leo Junior I, Pereira JC. Simulacao e lay-out de circuitos integrados [Internet]. Anais Cicte-90. 1990 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/96a9eccd-6435-4c54-bb4f-088815d68be8/prod_001925_sysno_0827656.pdf
Vancouver
Leo Junior I, Pereira JC. Simulacao e lay-out de circuitos integrados [Internet]. Anais Cicte-90. 1990 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/96a9eccd-6435-4c54-bb4f-088815d68be8/prod_001925_sysno_0827656.pdf
Trabalho de evento-resumo
Projeto de circuito bipolar analogico para assimilacao de tecnicas em microeletronica (1990)
Iwasaki, C T; Pereira, J C
Source: Anais Cicte-90. Conference titles: Congresso de Iniciacao Cientifica e Tecnologica em Engenharia. Unidade: EESC
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
IWASAKI, C T e PEREIRA, J C. Projeto de circuito bipolar analogico para assimilacao de tecnicas em microeletronica. 1990, Anais.. Sao Carlos: Cetepe, 1990. Disponível em: https://repositorio.usp.br/directbitstream/cbc5b23f-60e4-47c2-8557-ffcbda0c764c/prod_001925_sysno_0827658.pdf. Acesso em: 23 maio 2024.
APA
Iwasaki, C. T., & Pereira, J. C. (1990). Projeto de circuito bipolar analogico para assimilacao de tecnicas em microeletronica. In Anais Cicte-90. Sao Carlos: Cetepe. Recuperado de https://repositorio.usp.br/directbitstream/cbc5b23f-60e4-47c2-8557-ffcbda0c764c/prod_001925_sysno_0827658.pdf
NLM
Iwasaki CT, Pereira JC. Projeto de circuito bipolar analogico para assimilacao de tecnicas em microeletronica [Internet]. Anais Cicte-90. 1990 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/cbc5b23f-60e4-47c2-8557-ffcbda0c764c/prod_001925_sysno_0827658.pdf
Vancouver
Iwasaki CT, Pereira JC. Projeto de circuito bipolar analogico para assimilacao de tecnicas em microeletronica [Internet]. Anais Cicte-90. 1990 ;[citado 2024 maio 23 ] Available from: https://repositorio.usp.br/directbitstream/cbc5b23f-60e4-47c2-8557-ffcbda0c764c/prod_001925_sysno_0827658.pdf

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